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中国电网市场主要SoC厂商采用MIPS处理器开发智能电网解决方案

美普思科技公司（MIPS Technologies，Inc）以及杭州万工科技（Vango Technologies Inc.）宣布，双方将共同合作为中国快速成长的智能电网市场提供解决方案。万工科技将采用MIPS科技广受欢迎的 MIPS32M14K处理器内核，为智能电表和智能电网SoC提供32位微控制器功能。通过 MIPS联盟计划（MAP），双方将合作共同推广可靠的下一代智能电网解决方案。

目前，大部分智能电表都使用8位MCU。虽然这些MCU能满足现阶段的市场需求，但未来需要采用32位MCU来执行更复杂、不间断和更安全的处理作业。32位MCU能扩充电表功能以满足未来需求，并提供支持今后更复杂软件所需的硬件资源，能够实现不间断的现场升级。

万工科技CEO谭年熊博士表示：“在智能电网中，几乎没有任何事情比可靠性更重要的了。运用成熟并广受验证的 MIPS架构，我们能开发出具备高性能与低功耗特性的可靠32位解决方案。我们将与 MIPS合作，期望能为中国的智能电网市场作出更大的贡献。”

MIPS科技营销副总裁Gideon Intrater表示：“我们很高兴能与万工科技合作，这是一家在中国电网市场拥有领先地位的创新公司。我们的 M14K内核是基于业界标准的 MIPS架构，并为 MCU的特定技术挑战增强了功能。采用这款在嵌入式设计中已得到广泛应用的内核，万工科技将能开发出具有扩展性、低成本和高可靠性的32位 MCU解决方案。”

Spansion新型人机接口协处理器加速语音电子元件发展

Spansion公司推出Spansion语音协处理器——支持语音控制系统接口的人机接口（HMI）协处理器，它将定制型逻辑和硬件与Nuance公司的VoCon软件引擎完美地结合起来，为诸如语音之类的自然用户接口提供了一种专用资源。凭借Nuance Communications公司的语音技术，该款新产品是汽车、游戏和消费电子领域语音识别系统的理想之选。此外，该产品支持更大的语音数据库，显著提高响应时间和精度。Spansion语音协处理器由定制型逻辑和高速存储器构成，有利于加快和优化语音控制人机接口，同时还可消除常规CPU在处理语音数据时的工作负荷。

Nuance公司移动事业部执行副总裁兼总经理Michael Thompson表示：“Spansion以特有方式整合Nuance公司的技术，为汽车制造商提供了一种极其强大的平台。专业协处理器可以使语音互动变得极其快速、更加自然，甚至更加准确。”

越来越多的汽车制造商开始在汽车中装入语音识别接口，用于管理移动连接，同时提高驾驶安全系数。凭借其多年来在汽车领域的优势，Spansion技术的首次应用是在汽车市场。Spansion演示平台集成了Spansion公司的技术和Nuance公司的语音识别软件。Spansion语音协处理器充分利用了Spansion久经验证的技术，及其在各类嵌入式应用中实现即时响应、高可靠性和性能方面的领先优势。另外，Spansion语音协处理器能够支持更大的语音数据库（包括多语言，语音性别和声调），这样一来提高了准确性并促进了自然语言理解。

基准检测结果显示，与仅采用应用处理器的典型系统相比，使用Spansion语音协处理器可使系统响应速度提高50%。应用处理器上的负载最多可下降50%，使其可以腾出空间处理其他任务。发布会现场Spansion公司市场营销和业务开发总监范承华先生做了精彩演示，实测结果比官方数据还要略胜一筹。

Quartus II软件扩展支持28nm FPGA

Altera公司发布成熟可靠的最新版Quartus II开发软件。Quartus II软件12.0版进一步提高了用户的效能和性能优势，例如，对于高性能28nm设计，编译时间大大缩短。其他更新包括扩展28nm器件支持，初次支持Altera SoC FPGA，增强Qsys系统集成和DSP Builder工具，以及经过改进的知识产权（IP）内核等。

Quartus II软件12.0保持极快的编译时间，使得用户能够将设计团队资源集中在设计创新上，同时提高了设计人员的效能。Quartus II软件12.0扩展了对28nm FPGA的支持，初次支持具有硬核双核ARM Cortex－A9处理器的Altera SoC FPGA。用户可以选择并开始设计多种低成本、中端和高端28nm FPGA。

Xilinx丰富FEC IP核

赛灵思公司（Xilinx，Inc.）推出前向纠错（FEC）IP核的延伸系列。该系列产品包括GFEC、eFEC和高增益FEC（xFEC）解决方案，用于控制信号传输错误，延长传输距离，同时减少路线上再生器数量，从而有助于降低网络运营商的运营支出和资本支出。

赛灵思设计的FEC IP核采用常见接口，可加速产品开发，尽可能缩短系统级集成时间，最大化设计重复利用率，同时缩短产品上市时间。超小型高性能FEC核包括针对2.5G、10G、40G、100G应用的 GFEC IP核、传统10G eFEC以及针对100G应用的赛灵思扩展FEC（xFEC）IP核，这些产品专门针对赛灵思FPGA进行了优化。赛灵思还在努力为前沿应用推出400GGFEC。结合部分重配置技术，这些针对赛灵思FPGA优化的IP核使客户能够在多种接口上运用多种FEC标准，同时还能节约产品成本，降低功耗，最大限度地提高网络互操作性。

文章来源：《电子设计工程》网址: http://www.dzsjgc.cn/qikandaodu/2020/1020/714.html